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Cupl语言中的引脚扩展名是一个很强大的能力。合理地使用它,可以简化逻辑的设计,这样在设计中以带来便利的好处。
Cupl语言中引脚重要的扩展名包括:
扩展名 等式的某侧
.AP 左边(L) flip-flop的异步预置
.AR L flip-flop的异步复位
.APMUX L 多路选择器的异步预置
.ARMUX L 多路选择器的异步复位
.BYP L 可编程寄存器的旁路
.CA L Complement array
.CE L flip-flop的D触发器的输入使能
.CK L flip-flop的可编程时钟
.CKMUX L 多路器件的时钟
.D L flip-flop的D触发器的输入端
.DFB 右边(R) D 寄存器回馈路径选择
.DQ R D锁存器的 Q端 flip-flop
.IMUX L 多路选择器的2引脚的选择端
.INT R 寄存器宏单元的内部回馈路径
.J L JK触发器的 J 端 flip-flop
.K L JK触发器的 K 端 flip-flop
.L L D 输入锁存器
.LE L 可编程锁存器使能
.LEMUX L 锁存器使能多路选择器
.OE L 可编程输出使能
.OEMUX L 三态门的使能端
.PR L 可编程预置端
.R L flip-flop的RS触发器R输入端
.S L flip-flop的RS触发器S输入端
.SP L flip-flop的异步置位端S
.SR L flip-flop的异步复位端R
.T L flip-flop的T触发器输入端
由上面的列表可以知道,这些东西有些我们做小规模的PLD设计的时候根本用不上。如果是小规模的pld,上面的某些扩展名是不支持的,比如在GAL16V8B设计中,LE就不支持。不过,我们能用触发器就是一个很大的进步,这样可以在几百个门逻辑的规模下设计一些市面上买不到的器件。
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